Analog tasarım otomasyonunun devre ve sistem seviyelerinde kullanılan optimizasyon algoritmalarına yeni yaklaşımlar

Bu tezde, benzetimli devre sentezi için benzetim-tabanlı yöntem dizileri ve bu yöntem dizilerinin faydalılığını onaylamak amacıyla gerçekleştirilmiş olan sentez sonuçları sunulmaktadır. Ayrıca, devre sentezleyicinin sistem seviyesi ile birleştirilmesi de sunulmaktadır. Benzetim-tabanlı yaklaşım tercih edilmiş sonucunda sentezleyici, SACSES, HSPICE ile gerçekleştirilmiştir. Transistor boyutlarını ES algoritması kullanarak dolaylı olarak değiştiren iki farklı devre sentez yöntemi önerilmiştir. İlk yöntem tasarım parametresi olarak evirici katsayıya ve EKV MOSFET Model'in denklemlerine dayanır. İkinci yöntem doğru akım çalışma noktalarına ve bu noktaları transistor boyutlarına çeviren başvuru çizelgelerine dayanır. SACSES'i sistem düzeyindeki sentez araçlarıyla birleştirmek için sıradüzenli bir sentez yapısı önerilmiştir. Sıradüzenli yapı, devre ve sentez düzeylerini birleştirmek için ek araçlara olan gereksinimi ortadan kaldırmaktadır.